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allegro16.3电池焊盘封装信息

2019-08-15 19:56:46

allegro16.3在PCB中查看元件封装

Tool--Padstack---modifydesignpadstack-----点击PAD右键-edit

2019-08-15 19:54:05

allegro16.3左侧和上侧常用工具栏消失 解决办法

1:现象,红线划掉部分已消失2:解决办法:点击View菜单栏下ResetUItoCadenceDefault命令选项即可

2019-08-15 13:48:52

allegro PCB导入导出Available films文件

1:选中selectall2:再任意一栏右击选择saveallchecked,文件会自动保存在同级目录下的FILM_SETUP.txt5:在allegroPCB中导入光绘时需要选择的Availablefilms文件1:选择add添加所需要加入的films文件2:再重新和量产的工程进行一次比较,确认无误。...

2019-08-14 20:37:22

20190814 allegro16.3中负片电源和地的操作

负片中的网络不能用线连接!!!负片中的网络不能用线连接!!!负片中的网络不能用线连接!!!...第一种方法:先用antietch分割,在设置网络第二种方法:直接用shape设置某个电源网络区域负片电源的连接操作:1:画antietch线5v和3.3v之间用20mil分割就可以了(间距设置就是图片右侧的linewidth尺寸)正负12V之间40mi...

2019-08-14 20:30:12

20190814 allegro16.3生成gerber/光绘文件

光绘文件生成流程:1:DRC校验2:数据库校验3:查看光绘文件格式4:选择自动5:NCDrill和NCLegend中的选项(钻孔文件设置)ToolSequence-不用管RepeatCodes-不要选,很多CAM机不认识LeadingZeroSuppression-选上,这个大多...

2019-08-14 20:25:17

20190814 allegro16.3原理图编号

于博士视频14讲:1:重置原理图元器件编号为?2:更新元件编号

2019-08-14 14:41:29

20190814 allegro16.3快速修改丝印层文字的方法

1:选中丝印层text2:点击textedit图标3:弹出此对话框,即可从其他文本中快速复制文字过来

2019-08-14 10:43:25

20190814 cadence16.3设计PCB设置Route Keepin 或者route keepout间距

cadence16.3设计PCB设置RouteKeepin或者routekeepout的间距一般为0.3mm

2019-08-14 09:10:55

allegro16.3将元件放在指定坐标存在误差

可能产生的原因是point没有选择symorgin

2019-08-12 18:54:34

allegro16.3高亮没有网络连接的引脚

在设计PCB的时候我们会发现很有元件有很多焊盘事没有网络属性的,如果能够高亮这些这些管脚,将会利于我们对BGA器件的管脚善出,从而提高设计效率。今天教大家如何高亮没有网络属性的管脚。设置方法如下没有高亮前的效果,如下图:1、打开Display菜单栏下的AssignColor命令,也可直接单击工具栏下的“AssignColor“”图标按钮。2、在实行AssignColor命令后...

2019-08-09 18:54:13

allegro画原理图连接不通层次之间的电源name属性出现随机数字

解决方法:1:将出现随机数字的那一侧直接连到管脚,中间不走任何线,即可解决问题方法2:重新创建工程

2019-08-08 13:33:02

allegro16.3导入导出板框(DXF)

导出板框1:导出板框:仅显示“outline”层2::file>>EXport>>DXF...3::4::5:完毕。导入板框导入板框步骤:CAD保存为DXF格式–”File”–”Import”–”DXF”–选择DXF文件–勾选下图标④–点击”Edit/Viewlayers”进入–选择”Selectall”(注:导入CAD中的所有层)–Cla...

2019-08-07 16:03:20

cadence16.3修改板框尺寸

转自https://blog.csdn.net/qq_38376586/article/details/86742566

2019-08-07 15:35:16

cadence生成网络表时出现[ALG0047] "No_connect" property on Pin 警告

#66Warning[ALG0047]"No_connect"propertyonPin"U1.J15"ignoredforU1:SCHEMATIC1,06_Connector_KJ(129.54,15.24).Connectingpintonet"J15_HA14_P".原因:这个警告基本可以忽略;造成这个问题的原因是,设计之初先对器件相关的管脚上加...

2019-08-07 15:24:39

打开Cadence16.3 OrCAD最下面的对话框

2019-08-07 14:09:46

cadence16.3同一工程下建立不同页之间的net连接

第一步:添加off-pageconnector第二步:设置off-pageconnector后缀添加有页码

2019-08-07 11:14:58

网络分析仪log mag的含义

LogMag为回波损耗测试,主要用来测试天线的驻波比。驻波比与回波损耗的换算关系驻波比(VSWR):VoltageStandingWaveRatio回波损耗(RL):ReturnLoss换算公式:RL=20*log10[(VSWR+1)/(VSWR-1)]换算表格:...

2019-08-07 08:46:54

allegro16.3中删除尺寸标注方法

1:可以使用delete功能,find选择Lines和Text,选中需要删除的尺寸标注,删除即可

2019-08-06 19:29:18

ALLEGRO16.3高亮 颜色选择

2019-08-06 18:40:18

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