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原创 ADC采样率

上面的1s,100ms,1us分别对应的是1 sps、10 sps、1M sps采样率。可是实际我们测量出来的是95-105波动的,这是因为实际上的ADC不是理想器件,他会有误差。一个12位的ADC虽说能分辨0.0008V的电压,但是他的波动电压有10mv,那么这个分辨能力也就失去了他测得准的意义。如果让黑表头去触碰电源的负极,那么测出来的就是红表头所在的地方的电压。可以看到12位的ADC是没办法分辨0V和0.0004V,原因在于我们把0-3.3V分成了4096份,这个份数还不够多,要分成8192份。

2024-01-11 15:43:42 391 1

原创 状态机的verilog写法

其中,主控组合进程的任务是根据外部输入的控制信号和当前状态的状态值确定下一 状态的取向,并确定对外输出内容和对内部其他组合或时序进程输出控制信号的内容。“硬件设计很讲究并行设计思想,虽然用Verilog描述的电路大都是并行实现的,但是对于实际的工程应用,往往需要让硬件来实现一些具有一定顺序的工作,这就要用到状态机思想。状态机的参数定义采用的都是独热码,和格雷码相比,虽然独热码多用了触发器,但所用组合电路可以省一些,因而使电路的速度和可靠性有显著提高,而总的单元数并无显著增加。平常使用较多的是此类状态机。

2023-06-17 11:11:58 1554

原创 CRC码计算及校验原理

CRC校验

2022-12-03 10:19:25 691 1

原创 FPGA配置方式

FPGA配置

2022-12-03 08:44:07 998

原创 verilog 描述组合逻辑注意事项

verilog 描述组合逻辑注意事项

2022-10-19 14:36:29 328

原创 quartus常见warning处理办法

在Quartus II下进行编译和仿真的时候,会出现一堆warning,有的可以忽略,有的却需要注意,虽然按F1可以了解关于该警告的帮助,但有时候帮助解释的仍然不清楚,大家群策群力,把自己知道和了解的一些关于警告的问题都说出来讨论一下,免得后来的人走弯路.下面是我收集整理的一些,有些是自己的经验,有些是网友的,希望能给大家一点帮助,如有不对的地方,请指正,如果觉得好,请版主给点威望吧,谢谢1.Found clock-sensitive change during active clock edge at

2022-03-25 09:42:46 1559 2

原创 安捷伦仪器控制文档

l 信号功率分为三种:CW波功率、脉冲波功率、包络波功率l 脉冲波功率要求脉冲是有周期,如果没有周期,则测的不准l SCPI命令查询结果有3种方式:MEASure、READ、FETCH。FETCH不用等待count完成就取平均数,READ和MEASure都要等。READ可以指定count值,MEASure不可以。l 功率计有三种触发模式:Free Run、Single Shot、Continuous Triger Mode

2022-03-01 09:58:43 1128

原创 GPIB编程控件指令

#include “stdafx.h”#include “C:\Program Files\IVI Foundation\VISA\WinNT\agvisa\include\visa.h”#pragma comment(lib,“C:\Program Files\IVI Foundation\VISA\WinNT\agvisa\lib\msc\agvisa32.lib”)#include <stdio.h>void main () {ViSession defaultRM, vi;c

2022-02-23 09:19:06 3254 4

原创 Quartus中工程文件类型的含义

*.jic           JTAG Indirect Configuration File*.pin           Pin-Out File*.pof           Programmer Object File*.qpf           Quartus II Project File

2021-11-16 09:22:19 1238

原创 FPGA串口波特率计算

一 : 串口波特率等概念,115200等到底什么意思1:比特率:9600bps 、115200bps就是每秒中传输9600bit、115200bit,也就是相当于每一秒中划分成了9600等份。9600bps:那么每1bit的时间就是1/9600秒=104.16666666666666666666666666667us,约0.1ms。既然是9600等份。115200bps: 那么每1bit的时间就是1/115200秒=8.68us。每1bit紧接着下一个比特,不存在额外的间隔。也不管是啥起始bit,

2021-10-28 15:15:57 2244

原创 FPGA中“打一拍”

关于FPGA中“打一拍”的含义,我们可以理解为把某个信号延迟了一个时钟周期,推而广之:“打两拍”就是延迟两个时钟周期,“打n拍”就是延迟n个时钟周期。      “打一拍”的目的很简单,就是为了FPGA中时序的正确性!!!!(了保证FPGA输入输出接口的时序,一般会要求将输入管脚首先打一拍再使用,输出接口也要打一拍再输出FPGA。将信号打一拍的方法是将信号通过一次寄存器,而且必须在IOB里面的寄存器中打一拍。因为,从FPGA的PAD到IOB里面的寄存器是有专用布线

2021-10-28 11:23:16 2530

原创 UART协议介绍

1.UART协议介绍UART是一种通用串行数据总线,用于异步通信。UART能实现双向通信,在嵌入式设计中,常用于主机与辅助设备通信。UART包括RS232、RS449、RS423等接口标准规范和总线标准规范,即UART是异步串行通信口的总称。而RS232等式对应各种异步串行通信口的接口标准和总线标准,它们规定了通信口的电气特性、传输速率、连接特性和接口的机械特性等内容,实际上是属于通信网络中的物理层(最底层)的概念,与通信协议并没有关系。UART传输中,相关名词解释如下:(1)波特率:每秒钟发送的符号

2021-10-25 15:30:50 1008

static timing analysis for nanometer designs

纯原版,英文

2024-01-15

my_uart_rx.v

my_uart_rx.v

2022-02-14

自动控制原理,学习笔记

自动控制原理,学习笔记

2020-12-29

胡寿松自动控制原理真题解析

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2020-12-29

考研数二笔记,学习心得

适合考研的学子。

2020-12-29

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