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RSS订阅原创 分频电路的verilog实现
偶数2分频 由偶数二分频波形可知，每次在时钟的上升沿，寄存器的状态进行翻转，就能得到二分频后的时钟。代码如下：module div2_clk(input clk,input rst,output clk_div );reg clk_div_r;assign clk_div = clk_div_r;always@(posedge cl
2021-04-23 16:34:18
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原创 2021届oppo提前批[芯片设计岗位面经]
oppo提前批，无笔试，之前面试的几家公司只有vivo是有笔试的，其他都没有笔试，oppo面试一对一，面试30分钟左右。oppo面试官是一个女生，有点点小惊讶，毕竟一直听说oppo是不怎么招女生的。 oppo面试也是主要问项目，但是感觉她不了解我做的项目，所以主要是我在说（汇顶和中兴的很懂，问的很细致）。问到的有：1、简单自我介绍一下自己的项目，然后让仔细的说了其中几个模块是怎么实现的2、FPGA怎么供时钟的，and why？3、FIFO的设计，FIFO设计时应...
2020-08-02 20:32:30
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原创 2021届中兴提前批[FPGA工程师/数字IC岗位面经]
中兴其实我也不知道我面试的什么岗位，上周五下午hr给我打电话问我周六有没有时间面试的时候，说的是长沙的FPGA的岗位，但是我面试的时候，面试官说深圳的FPGA岗位更加适合我现在所做的，而长沙的是数字IC的岗位，因为我本来也是奔着长沙的岗位去的，所以表达了想留在长沙的想法。 周六上午的汇顶和下午的中兴都是没有笔试的，直接安排了面试。中兴下午面了一个多小时，面的特别难，细节扣得很仔细，直接被问趴的那种。面试形式：三面一。 只问了项目，能记得的问题有：面试官一：1、自我介绍以及...
2020-07-28 20:41:10
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原创 2021届汇顶提前批[FPGA工程师岗位面经]
汇顶在正式面试前，有个简历初筛，进行了半个小时的电话面试，后面收到了正式的视频面的短信。 面试在上周六上午九点，汇顶有三次面试，一面技术面，二面hr面，三面综合面，都是在一个上午面完的，面了一上午。电话面试 在进行电话面试之前没有通知，下午直接打电话过来问方不方便面试，由于下午不太方便，所以把时间调整到了晚上。 电话面试主要也是问的技术相关。 首先让进行了自我介绍。然后让简单介绍自己的项目，主要的框架和结构都让详细的说明，然后主要就是面试官进行提问。 项目上的问题问的比较多，具体的不多说。.
2020-07-28 15:11:11
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原创 2021届vivo提前批[芯片设计岗位面经]
2021届vivo提前批[芯片设计岗位面经] 第一次写博客，分享一下自己的面试经验，希望能帮助现在在准备找工作的朋友们。一直以来，都是默默看别人的面经，享受别人分享带来的益处，希望自己也能帮到他人。1、一面技术面首先面试官让进行了自我介绍，不知道是网络原因还是电脑原因我没听清楚是30s还是3min，后面是按照自己的准备的自我介绍说完的。接下来正式进入面试环节，面试内容主要包括三个部分：第一方面主要是：项目上的细节，自己所负责的部分以及自己所用FPGA的结构相关问题，举几个小问题：sp
2020-06-14 20:32:30
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空空如也
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