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比特电子工作室

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原创 比特FPGA简介

01 工作室简介在工作之余，笔者与志同道合的朋友成立了博客所示的“比特电子工作室”（BIT-FPGA），目的很简单： 为工作和学习中所接触到的知识找到一个落脚点，将掌握的知识和技能分享给同道的朋友； 同时也是为了提高自身的学习的效率和目的性；再一个就是将知识转换成生产力； 做一个高度专业的 FPGA案例设计、IP核设计、FPGA设计培训教学的专业供应商。博客主要板块如下：（1）FPGA ...

2019-02-19 17:41:12 1198 1

原创 09 因果稳定性

各位看官，大家好！本讲为《数字信号处理理论篇》09因果稳定性。（特别提示：课程内容为由浅入深的特性，而且前后对照，不要跳跃观看，请按照文章或视频顺序进行观看。

2024-03-18 17:20:51 192

原创 08 线性卷积

线性卷积，不仅定义了线性时不变系统对输入信号的响应，而且充分展示其物理含义。数字信号处理则是建立在这一法则上运行的，从此我们可以通过卷积的方式求解系统的响应。学习了这一课，你的战力又再次提升了呢，升级打怪的道路越来越顺畅。最近阳春三月，万物复苏，可惜身体略有抱恙，也不知是否是新冠后对身体影响较大，还是随着年龄增长抵抗力下降，不过这又有什么关系呢？相信抱恙也只是暂时的，只要不影响敲键盘，承诺过的更新绝不推迟。（特别提示：课程内容为由浅入深的特性，而且前后对照，不要跳跃观看，请按照文章或视频顺序进行观看。

2024-03-10 10:00:10 182

原创 07 系统的线性时不变特性

本讲为《数字信号处理理论篇》07 系统的线性时不变特性。（特别提示：课程内容为由浅入深的特性，而且前后对照，不要跳跃观看，请按照文章或视频顺序进行观看。

2024-03-05 16:01:29 167

原创 06 基于单位脉冲信号的信号合成与分解

本讲为《数字信号处理理论篇》06 基于单位脉冲信号的信号合成与分解。

2024-02-28 09:09:21 209

原创 05 正弦序列的周期性

本讲为《数字信号处理理论篇》05 正选序列的周期性。

2024-02-24 12:14:48 190

原创 04 典型序列与典型信号

本讲为《数字信号处理理论篇》04 典型序列与典型信号。（特别提示：课程内容为由浅入深的特性，而且前后对照，不要跳跃观看，请按照文章或视频顺序进行观看。

2024-02-21 09:25:14 201

原创 03_3 连续时间信号的傅里叶变换（FT） 周期信号的傅里叶变换

本讲为《数字信号处理理论篇》03_3 连续时间信号的傅里叶变换 周期信号的傅里叶变换。（特别提示：课程内容为由浅入深的特性，而且前后对照，不要跳跃观看，请按照文章或视频顺序进行观看。

2024-02-02 13:00:00 303

原创 03_2 连续时间信号的傅里叶变换（FT） 非周期信号的傅里叶变换

本讲为《数字信号处理理论篇》03_2 连续时间信号的傅里叶变换 非周期信号的傅里叶变换。（特别提示：课程内容为由浅入深的特性，而且前后对照，不要跳跃观看，请按照文章或视频顺序进行观看。

2024-01-27 15:41:54 150

原创 03_1 连续时间信号的傅里叶变换（FT） 周期信号的傅里叶级数

各位看官，大家好！本讲为《数字信号处理理论篇》03_1 连续时间信号的傅里叶变换 周期信号的傅里叶级数。（特别提示：课程内容为由浅入深的特性，而且前后对照，不要跳跃观看，请按照文章或视频顺序进行观看。

2024-01-24 17:00:00 361

原创 02_3 连续时间信号的傅里叶级数（FS） 复指数形式的傅里叶级数

本讲为《数字信号处理理论篇》02_3 连续时间信号的傅里叶级数 复指数形式的傅里叶级数。

2024-01-17 17:30:00 299

原创 02_2 连续时间信号的傅里叶级数（FS） 三角形式的傅里叶级数

本讲为《数字信号处理理论篇》02_2 连续时间信号的傅里叶级数 三角形式的傅里叶级数。

2024-01-09 09:42:38 372

原创 02_1 连续时间信号的傅里叶级数 认识正弦波

本讲为《数字信号处理理论篇》02_1 连续时间信号的傅里叶级数 认识正弦波。（特别提示：课程内容为由浅入深的特性，而且前后对照，不要跳跃观看，请按照文章或视频顺序进行观看）

2024-01-04 09:31:25 375

原创 01 数字信号处理--引言

各位看官，大家好！笔者在此祝大家元旦节快乐。信守承诺，准时为大家奉上元旦节礼物，《数字信号处理理论》课程，本讲为课程第一讲，引言部分，下面对课程内容进行简介。

2023-12-28 17:28:16 356

原创 《数字信号处理理论篇》课程大纲

各位看官大家好，经过四个月的课程规划和课件准备工作，目前《数字信号处理理论篇》视频课程已准备就绪，在这段时间中，作者夜以继日努力在规定的时间期限内完成本课程的准备工作。的特点，并把《信号与系统》与《数字信号处理》两门课程的内容进行了对照，使得课程更容易理解。

2023-12-06 11:24:57 79

原创 CASE_05 基于FPGA的DDS信号发生器

目录1 简介2 DDS原理与方案2.1 方案一：基于CORDIC算法实现2.2 方案二：基于ROM查找表的实现方式3 DDS信号发生器的模块设计3.1 按键消抖模块3.2波形选择模块3.2.1 波形选择模块代码3.3频率调整模块3.3.1 频率调整模块代码3.4显示数值分解模块数码管译码与动态扫描模块3.6DDS波形合成模块4DDS信号发生器的系统设计4.1 DDS信号发生器顶层设计代码4.2DDS信号发生器系统模块框图...

2021-08-24 17:03:42 3209

原创 CASE_04 基于FPGA的电梯控制器

目录1 简介2. 电梯控制器简介2.1 电梯控制器的设计框图3 电梯控制器的模块设计3.1按键消抖模块3.2电梯运行主逻辑模块3.2.1 步骤一：明确设计目标信号 3.2.2步骤二：确定逻辑划分（状态机）3.3步进电机驱动模块3.3.1 步进电机的基本知识3.3.2 步进电机驱动代码3.4状态显示模块3.4.1状态显示模块简介3.4.2按键模块代码4电梯控制器的系统设计4.1 电梯控制器顶层设计代...

2021-08-24 16:01:33 6183 5

原创 CASE_03 基于FPGA的等精度数字频率计

目录1. 简介2.数字频率计的基本原理2.1 数字频率计的设计方案2.1.1 方案一：M法测频原理2.1.2方案二：T法测频原理2.1.3 方案三：M/T法原理（等精度测量法）3 数字频率计的模块设计3.1测频模块3.2显示数值分解模块3.3数码管译码与动态扫描模块4数字频率计的系统逻辑设计4.1 频率计顶层设计代码4.2 频率计系统模块框图5硬件设计5.1电源接口电路设计5.2电源...

2021-08-24 14:35:27 3107 2

原创 CASE_02 基于FPGA的数字钟万年历

1 简介本数字钟实则是数字钟万年历，具备以下功能：（1）数码管可显示：时分秒，年月日，闹钟时间；（2）可实现时分秒、年月日、闹钟时间的任意设定；（3）自动实现大小月与闰年的判断；2 数字钟计数方案2.1计数方案一计数方案一，如图：该计数方案，比较符合人类思维对时间的认知，在FPGA逻辑也比较好实现，对年月日时分秒的逻辑都一样好实现，尤其是在月份的大小的判断计数和闰年的判断都好处理；但是存在一个致命的缺点，产生的结果不能直...

2021-07-11 20:37:17 5562 1

原创 CASE_01 基于FPGA的交通灯控制器

目录1 案例引导1.1 硬件设计初窥1.2逻辑设计初窥2 模块级逻辑设计2.1 时钟分频模块2.2 数码管译码模块2.3主逻辑运行模块3 系统逻辑设计4 硬件设计4.1电源接口电路设计4.2电源系统设计4.3时钟设计4.4 JTAG端口和FPGA配置电路设计4.5FPGA芯片的电源引脚4.6 A方向信号灯电路4.7 B方向信号灯电路4.8 复位电路4.9PCB设计图4.10实物图5 实物验证5.1管...

2021-07-11 15:49:19 5827 6

原创 PREFACE FPGA经典案例序言

本系列博客为笔者在本科学习阶段的课程设计 或则 自学习的一些经典案例。 笔者在本科学习阶段很喜欢把自己做过的设计通过文档的形式记录下来，同时也把相关的学习资料都放在一起，形成一个系统学习该案例的资料集合，每次上交作业时，笔者会把能想到的设计思路和设计结果都写在课程设计的作业里，所以每次课程设计都能得到一个比较优秀的分数。每次虽然花掉很多时间，以至于比寝室同学都少玩了很多游戏，但是自己觉得这样是值得的，毕竟学友所获。这些资料已经在笔者的笔记本电脑里躺了好长时间了，本次笔者打算把这些课程设计的文...

2021-07-11 14:37:35 920 2

原创 使用MATLAB快速完成对ADC信号质量的分析

目录1 单音信号分析2 复数信号分析 在硬件调试初期时，通常需要对ADC采样的信号质量进行一些列分析，可以利用强大的数学工具MATLAB对信号质量进行分析，包括时域绘图、频域绘图、功率谱等。1 单音信号分析 通常在ADC测试时，会在ADC上输入一个单音信号，将采集回来的数据进行分析。 使用VIVADO中的ILA将ADC数据采集下来，保存为xxxx.csv文件，保存时所有数据均设置为有符号数，以确保matlab在读取数据时不会报错。如...

2021-05-07 15:53:21 3040 1

原创 ADI官方源码快速搭建demo工程验证设计的正确性

1 ADI官方demo工程设计简介 ADI官方的官方demo板的整套快速设计是相当给力的，在购买官方开发后，可通过官方例程可以快速学习对应AD/DA的使用方法。 示例设计往往建立在Xilinx或Altera的官方开发板上的，所以ADI推出了在大厂FPGA上快速构建demo工程的设计流程。在产品设计上，可以采用与大厂开发板和ADI demo板类似的原理设计，这样不仅可以减小硬件设计的风险，同时软件设计可以在官方demo工程上进行较小的修改，大大减小了软件设计的工作量。2 ADI官...

2021-05-07 14:28:15 3124 1

原创 10G_Ethernet_04 10G Ethernet Subsystem IP 的快速验证(万兆以太网IP的快速验证)

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此：https://blog.csdn.net/qq_33486907/article/details/110180317《10G_Ethernet_01 万兆以太网设计引言》目录1 验证方案2 验证实验3 如何验证自研板卡的 10G 以太网的功能3.1 PCS 环回的作用3.2 对误码率的测试 对 IP 进行快速验...

2020-12-01 15:00:35 4090 25

原创 10G_Ethernet_03 Example Design

目录1 Example Design 简介2 Example Design 详解2.1 AXI-Lite Control State Machine2.2 Basic Pattern generator and checker2.2.1 address_swap2.2.2 Pattern generator2.2.3 Pattern checker2.3 Ethernet FIFO2.3.1 RX FIFO2.3.2 TX FIFO3 Test Bench3.

2020-11-27 13:50:20 5281

原创 10G_Ethernet_02 10G Ethernet Subsystem 简介

目录1 10G Ethernet MAC2 10G Ethernet PHY2.1 10GBASE-R2.2 10GBASE-KR 10G 以太网子系统框图如图所示， 子系统(注： 10G Ethernet Subsystem 下文均称子系统)主要由 10Gbs 以太网 MAC、（PHY） 物理编码子层（PCS）物理和物理媒介适配层（PMA） 组成，从概念上与千兆、百兆以太网是一样的。以太网 MAC ： 10 Gigabit Ethernet MAC 提供 AXI4-...

2020-11-27 09:52:44 7002

原创 10G_Ethernet_01 万兆以太网设计引言

目录1 简介2 万兆以太网简介1 简介 从本片文章开始，笔者将给读者带来一个全新系列的文章，系统地讲解万兆以太网的设计原理、设计思路。内容包含万兆以太网的MAC/PCS/PMA简介以及UDP/ARP协议在万兆以太网中的实现，最后将设计融入到FPGA中，并上板进行验证。涉及到使用的主要器件包含XILIXN的FPGA,开发环境为VIVADO2018.2等。2 万兆以太网简介 在日常生活中，最为常见的以太网接口均为百兆或千兆以太网口，如笔记本电脑或台式机的...

2020-11-26 14:31:30 5723

原创 FIR_01 基于FPGA的FIR滤波器 （FDATOOL ISE ） 第一篇：初步认识和应用

1 简介 对于FIR滤波器的理论部分，在本系列博客中不做论述，或许在后续更新的文章中会对其理论进行讨论。 本文为该系列博客的第一篇文章，将以最简单直观的方式让初学者体会到FIR滤波器的作用，采用最傻瓜的方式讲解FIR滤波器的设计与应用。 同时本系列博客将讲解多种FIR滤波器的设计方式，本篇文章就先讲解其中一种。 本系列博客涉及的工具将包...

2019-07-03 11:51:32 1421

原创 TIMING_06 VIVADO环境下的时序约束 之 输入延迟约束

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此：https://blog.csdn.net/qq_33486907/article/details/89380368《TIMING_01 时序约束与时序分析》目录1.输入延迟约束1.1同步方式 之 系统同步1.1.1 传输线...

2019-07-02 09:44:19 3280 9

原创 TIMING_05 VIVADO环境下的时序约束 之 基本时钟周期约束

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此：https://blog.csdn.net/qq_33486907/article/details/89380368《TIMING_01 时序约束与时序分析引导篇》目录1. 基本时钟周期约束1.1 时钟周期约束的性质1.2 Prim...

2019-04-25 09:08:29 3679 6

原创 TIMING_04 时序约束的一般步骤

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此：https://blog.csdn.net/qq_33486907/article/details/89380368《TIMING_01 时序约束与时序分析引导篇》1. 时序约束的一般步骤 本章将讲解一下时序约束的一般步骤，...

2019-04-19 09:57:12 1316

原创 TIMING_03 时序分析原理

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此：https://blog.csdn.net/qq_33486907/article/details/89380368 《TIMING_01 时序约束与时序分析引导篇》目录1 时序分析原理1.1 发射沿和捕获沿1.2 4类时序路径（...

2019-04-19 09:37:28 2455 1

原创 TIMING_02 浅谈时序约束与时序分析

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此：https://blog.csdn.net/qq_33486907/article/details/89380368《TIMING_01 时序约束与时序分析引导篇》目录1 时序约束与时序分析1.1 保证数字电路的正确性...

2019-04-19 09:10:06 2381

原创 TIMING_01 时序约束与时序分析引导篇

笔者前段时间推出AXI总线IP核系列博客（传送门在此：https://blog.csdn.net/qq_33486907/article/details/88289714） ，现在有要推出时序约束和时序分析的系列文章了。这两个系列的文章有着一个共同特点，那就是大多数培训机构和开发板的资料教程不讲，或则只讲些皮毛，更有离谱的是不同的人对同一个约束存在不同的理解，对于还没有入门的人很...

2019-04-18 17:03:30 1889 2

原创 AXI_05 AXI_FULL_IP的设计与验证

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此： https://blog.csdn.net/qq_33486907/article/details/88289714 《AXI_01 《AXI总线系列文章》由来》目录1. AXI_FULL_IP1.1 AXI_FULL_MASTER_IP设计...

2019-03-07 15:09:47 3231 7

原创 AXI_04 AXI_LITE_MASTER_IP设计与验证

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此： https://blog.csdn.net/qq_33486907/article/details/88289714 《AXI_01 《AXI总线系列文章》由来》目录1 AXI_LITE_MASTER_IP1.1 AXI_LITE_MASTE...

2019-03-07 14:34:11 2705 1

原创 AXI_03 AXI_LITE_SLAVE_IP核设计与验证

由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此： https://blog.csdn.net/qq_33486907/article/details/88289714《AXI_01 《AXI总线系列文章》由来》目录1.AXI_LITE_SLAVE_IP1.1 AXI_LITE_SLAVE_IP...

2019-03-07 13:55:48 4264

原创 AXI_02 AXI4总线简介（协议、时序）

本篇文章内容在各大资料上都可找到，内容摘自专业书籍，这里作为该系列文章的原理篇。由于该系列文章阅读有顺序性，所以请跳转至该系列文章第一篇从头开始阅读，并按照文章末尾指示按顺序阅读，否则会云里雾里，传送门在此： https://blog.csdn.net/qq_33486907/article/details/88289714 《AXI_01 《AXI总线系列文章》由来》目录1 简...

2019-03-07 11:47:37 12566

原创 AXI_01 《AXI总线系列文章》由来

笔者从学习ZYNQ开始接触AXI总线，绝大多数学习ZYNQ的资料中都是从定义一个简单的自定义IP核开始的，设计一个通过PS端ARM，写一段C代码通过AXI总线读写自定义IP核的寄存器来，来完成LED流水灯的演示。不得不说这确实是一种比较容易让初学者入门的好案例，但是至此很多开发板资料和培训教学内容就是抱着点到为止的态度，没有进一步去讲解更多AXI总线在FPGA应用中的妙用，以此笔者有了发布《AXI...

2019-03-07 11:10:23 3211 2

基于FPGA的交通灯控制器 Traffic_light_VHDL_new.rar
基于FPGA的交通灯控制器VHDL资料合集，包含源码工程、仿真工程、视频教程、原理图PCB图，是FPGA经典案例系列博客的其中资源之一，系列博客地址：https://blog.csdn.net/qq_33486907/article/details/118653742 欢迎浏览。

2022-04-03

基于FPGA的DDS信号发生器 : DDS_Verilog.rar
基于FPGA的DDS信号发生器 Verilog资料合集，包含源码工程、仿真工程、视频教程、原理图PCB图，是FPGA经典案例系列博客的其中资源之一，系列博客地址：https://blog.csdn.net/qq_33486907/article/details/118653742 欢迎浏览。

2021-08-26

基于FPGA的电梯控制器 第二卷 :Elevator_contorller_Verilog.part2.rar
基于FPGA的电梯控制器Verilog资料合集，包含源码工程、仿真工程、视频教程、原理图PCB图，是FPGA经典案例系列博客的其中资源之一，系列博客地址：https://blog.csdn.net/qq_33486907/article/details/118653742 欢迎浏览。 由于资源过大超过CSDN 1000M的限制，所以此资源为压缩卷第二卷，第一卷地址为： 两卷要放在同一个文件夹下才能解压成功。

2021-08-26

基于FPGA的电梯控制器 第一卷 :Elevator-contorller-Verilog.part1.rar
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2021-08-26

基于FPGA的等精度数字频率计 Frequency_indicator_VHDL.rar
基于FPGA的等精度数字频率计VHDL资料合集，包含源码工程、仿真工程、视频教程、原理图PCB图，是FPGA经典案例系列博客的其中资源之一，系列博客地址：https://blog.csdn.net/qq_33486907/article/details/119887681 欢迎浏览。

2021-08-26

基于FPGA的等精度数字频率计 Frequency_indicator_Verilog.rar
基于FPGA的等精度数字频率计Verilog资料合集，包含源码工程、仿真工程、视频教程、原理图PCB图，是FPGA经典案例系列博客的其中资源之一，系列博客地址：https://blog.csdn.net/qq_33486907/article/details/119887681 欢迎浏览。

2021-08-26

基于FPGA的数字钟万年历 第二部分：Clock_Verilog.part2.rar
基于FPGA的数字钟万年历Verilog资料合集，包含源码工程、仿真工程、视频教程、原理图PCB图，是FPGA经典案例系列博客的其中资源之一，系列博客地址：https://blog.csdn.net/qq_33486907/article/details/118653742 欢迎浏览。 由于资源过大超过CSDN 1000M的限制，所以此资源为压缩卷第二卷，第一卷地址为：https://download.csdn.net/download/qq_33486907/20203102 两卷要放在同一个文件夹下才能解压成功。

2021-07-11

基于FPGA的数字钟万年历 第一部分：Clock_Verilog.part1.rar
基于FPGA的数字钟万年历Verilog资料合集，包含源码工程、仿真工程、视频教程、原理图PCB图，是FPGA经典案例系列博客的其中资源之一，系列博客地址：https://blog.csdn.net/qq_33486907/article/details/118653742 欢迎浏览。 由于资源过大超过CSDN 1000M的限制，所以此资源为压缩卷第一卷，第二卷地址为： https://download.csdn.net/download/qq_33486907/20203123 两卷要放在同一个文件夹下才能解压成功。

2021-07-11

基于FPGA的交通灯控制器 Traffic_light_Verilog.rar
基于FPGA的交通灯控制器Verilog资料合集，包含源码工程、仿真工程、视频教程、原理图PCB图，是FPGA经典案例系列博客的其中资源之一，系列博客地址：https://blog.csdn.net/qq_33486907/article/details/118653742 欢迎浏览。

2021-07-11

基于FPGA的FIR滤波器 （FDATOOL ISE ）.rar
基于FPGA的FIR滤波器 （FDATOOL ISE ）博客专属源码工程和视频教程，博客地址如下： https://blog.csdn.net/qq_33486907/article/details/94548599

2021-06-26

时序约束与时序分析完整版指导文档.rar
时序约束与时序分析系列博客，完整版PDF指导文件。博客地址： https://blog.csdn.net/qq_33486907/article/details/89380368

2021-06-26

AXI总线（轻松搞定AXI总线）源码和验证工程AXI4.rar
AXI总线系列博客专属源码和验证工程，博客地址如下： https://blog.csdn.net/qq_33486907/article/details/88289714

2021-06-26

Cygwin64 AD9361_demo.rar
博文 ADI官方源码快速搭建demo工程验证设计的正确性https://blog.csdn.net/qq_33486907/article/details/116482927 的设计资源,demo工程已完成编译，欢迎下载收藏

2021-05-07

基于FPGA的万兆以太网示例设计
压缩包为万兆以太网示例设计，可使用Vivado2018.2或以上版本打开，示例工程可进行仿真，也可进行快速的上板验证。可结合对应的博文进行学习和使用，博文地址 https://blog.csdn.net/qq_33486907/article/details/110180317

2020-11-27

空空如也

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