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1原创 全网拿来即用的QT项目-串口通信和绘图数据保存
全网拿来即用的QT项目，比一般的简单串口添加了数据保存和绘图。可以节省大量的事件，直接在工程上面修改
2024-03-04 15:43:19
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原创 深入浅出玩转FPGA——笔记8 漫谈状态机设计
硬件的并行性决定了用不同verilog描述的硬件实现（比如不同的always语句）都是并行执行的，那么如果希望分多个时间完成一个任务，怎么办？方法1 可以用多个使能信号赖衔接多个不同的模块，但是这样做多少显得有些繁琐。方法2 状态机应运而生。
2023-08-31 16:25:26
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原创 9.23年5月份生活有感
生活还是挺好的，但是最近遇到一个人好像，我对自己的生活有了不一样的期待！为什么我们要选择大多数人选择的生活，难道真的有传说的那么好吗？如果我尝试了另一种选择，又能给到自己满意的答案吗？如果多年之后回忆起来，我会是何种的感想呢？
2023-05-23 01:20:58
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原创 VHDL的基本语法（一）
VHDL语法学习，参考https://blog.csdn.net/qq_36243942/article/details/83041586
2023-05-10 15:51:25
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原创 自己动手写CPU——第二篇
ori是进行逻辑 或 运算的指令，其指令格式如下所示从以上的指令格式，我们可以直到，这是一个I类型指令，ori指令的指令码是 6‘b001101，所以当处理器发现正在处理的指令的高6bit 是 001101 的时候，就知道当前正在处理的是 ori指令。指令的用法是：ori rs rt immediate，作用是将指令中的16位立即数 immediate 进行无符号扩展至32位，然后与索引为rs 的通用寄存器的值进行逻辑 或 运算，运算的结果保存到索引 rt 的通用寄存器中。
2023-04-13 22:04:13
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基于串口校时的数字钟设计
2022-06-16
基于最小二乘法的定位算法——matlab仿真_注释齐全
2019-04-01
空空如也
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