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原创 MATLAB+VIVADO设计FIR滤波器

提示:文章写完后,目录可以自动生成,如何生成可参考右边的帮助文档文章目录前言 一、滤波器系数的生成 二、FPGA的实现 1.FIR滤波器IP核 2.导入参数 总结前言 数字信号处理中需要用到FIR滤波器进行一些滤波处理或加窗,XILINX 7系列的FPGA,在vivado下通常使用IP核生成可使用的滤波器,下面介绍配置方法。一、滤波器系数的生成首先在matlab的APP中找到filter designer或在命令行里输入: fdatool...

2020-09-10 10:43:27 6058 2

Vivado下verilog除法器(较少资源占用)

减少资源占用的一种除法器,可完成32位整数除法运算,并得出余数。

2019-04-16

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