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原创 燃烧我的大论文

最近在写毕业学位论文,到了瓶颈期,实在难受,憋不出来,仅以此歌来打趣打趣。《燃烧我的大论文》每天起床第一句,先给自己打个气每天多玩小手机,都要说声对不起导师导师救救我,我的论文如何写毕业,我要毕业,我要赶紧挣大钱毕业 毕业我要赶紧挣大钱为了写上一页纸天天蹲在实验室为了完成一章节东平西凑我都使想到还有几十天可惜实验我还没做努力我要努力我要完...

2018-11-16 09:02:04 420 2

原创 2019届华为秋招面试

其实秋招过去已经很久了,距离我面试华为8.17也快三个月了,有些已经记忆模糊,但是还是想记录一下。秋招开始的比较早,报了华为的优招,大概7月份收到笔试通知,报的软件测试岗,笔试与软件开发是一样的的,都是三道编程题。然后隔了几天收到测评,基本上收到测评就是笔试通过了。然后8月初放暑假在家收到了电话通知8月17号去华为南研所参加面试。这个日期我记得很清楚,一来是当天是情人节,二来当天下了瓢泼大...

2018-11-15 17:45:40 24124 40

原创 各数据类型所占字节

不同的数据类型所占字节数不同。在32位处理器和64位处理器下数据类型所占字节数是一样的,不同的是指针类型。一、32位处理器:char:1个字节char*p:4个字节int:4个字节unsigned int:4个字节double:8个字节short:2个字节long:4个字节long long:8个字节unsigned long:4个字节二、64位处理器...

2018-07-19 10:07:43 14660 4

原创 大疆2019届秋招笔试--测试工程师

大疆今年秋招开始的特别早,5月30-6月30进行简历投递,然后进行性格测评,通过后收到笔试通知,有两场可选,7月6日或7月8日。我选择了7月6日的笔试,测试工程师的题量不大,但是考的范围特别广,涉及操作系统、数据库、图像处理以及一些摄影技巧等等。一.单选题(20道*2)印象深刻的几道题:手机800万像素相当于分辨率多少?图像帧率计算IP问题概率计算内存溢出问题二叉树问题边界值测试(商场活动,300...

2018-07-09 10:09:37 8947 4

原创 计算机三级-嵌入式系统开发与研究-嵌入式系统概论

1.何谓嵌入式系统?IEE从应用角度定义嵌入式系统是“控制、监视或者协助设备、机器、工厂运行的装置”,这里的装置指计算装置,即计算机。“嵌入式系统”、“嵌入式计算机”、”嵌入式计算机系统“同义,都泛指嵌入在设备或系统中的专用计算机系统,既包含硬件也包含软件。2.嵌入式系统特点?(1)专用性(2)隐蔽性(3)资源受限:小、轻、低功耗、低成本(4)高可靠性(5)实时性(6)软件固话...

2018-07-08 17:36:16 390

原创 秋招面试常见问题--计算机网络

1.TCP/UDP区别?1.1 TCP面向连接(如打电话要先拨号建立连接);UDP是无连接的,即发送数据之前不需要建立连接1.2 TCP提供可靠的服务。也就是说,通过TCP连接传送的数据,无差错,不丢失,不重复,且按序到达;UDP尽最大努力交付,即不保证可靠交付     Tcp通过校验和,重传控制,序号标识,滑动窗口、确认应答实现可靠传输。如丢包时的重发控制,还可以对次序乱掉的分包进行顺序控制。1...

2018-07-07 21:05:19 609

原创 秋招面试常见问题--数据库

1.sql优化?为什么要进行sql优化:慢SQL消耗了70%~90%的数据库CPU资源;SQL语句独立于程序设计逻辑,相对于对程序源代码的优化,对SQL语句的优化在时间成本和风险上的代价都很低;SQL语句可以有不同的写法;如何进行sql优化:1.1 不使用子查询1.2 避免函数索引1.3 用IN来替换OR1.4 LIKE双百分号无法使用到索引1.5 读取适当的记录LIMIT M,N1.6 避免数据...

2018-07-07 20:48:29 363

原创 秋招面试常见问题--操作系统

一.操作系统1.线程进程区别?2.进程通信方式?3.死锁(代码实现)?死锁定义:是指两个或两个以上的进程在执行过程中,因争夺资源而造成的一种互相等待的现象,若无外力作用,它们都将无法推进下去。此时称系统处于死锁状态或系统产生了死锁,这些永远在互相等待的进程称为死锁进程。 由于资源占用是互斥的,当某个进程提出申请资源后,使得有关进程在无外力协助下,永远分配不到必需的资源而无法继续运行,这就产生了一种...

2018-07-07 20:34:34 449

原创 电子工程交流平台

比较知名的有:ChinaAET、电子发烧友、21IC、CSDN

2018-06-05 15:17:26 234

转载 简述MATLAB中floor、round、ceil、fix取整函数的区别

matlab有多个取整函数,其各个用法效果不同,需要加以区分fix朝零方向取整,如fix(-1.3)=-1; fix(1.3)=1;floor,顾名思义,就是地板,所以是取比它小的整数,即朝负无穷方向取整,如floor(-1.3)=-2; floor(1.3)=1;floor(-1.8)=-2,floor(1.8)=1ceil,与floor相反,它的意思是天花板,也就是取比它大的最小整数,即朝正无...

2018-05-08 10:37:39 577

原创 FPGA基础学习——简易串口发送

首先需要了解uart 的通信协议和传输时序uart通信首先将接收到的并行数据转换成串行数据来传输。消息帧起始位为低电平,后面接7或8个数据位(大部分为8个数据位),1个可用的奇偶校验位(根据数据中1的个数是否为偶数(偶校验位)还是奇数(奇校验位)),1个或者多个高位停止位。(传输一个字节大约需要10个比特位)接收器发现开始位时知道数据准备发送,并尝试与发送器时钟频率同步。如果选择了奇偶校验位,可以...

2018-05-03 22:17:25 3575 1

原创 FPGA基础学习——状态机

以FPGA流水灯点亮为例传统流水点电点亮可以利用计数器,当每计数49_999_999 (即1s)时,依次循环点亮LED0~LED3;verilog 示例如下:module led(                 input clk,        //系统时钟,50MHz                 output reg [3:0] led   // 4个led灯输出,高电平点亮      ...

2018-05-03 21:47:58 509 1

原创 关于信号采样

自己学习图像,视频,但是发现对最基本的信号采样还未理解透,深表惭愧,所以打算从最最基础学习一下通信相关理论,打好基础,才能更好的进行后面的研究学习。首先理解何为信号采样?简单说就是对于连续的信号x(t)(即模拟信号),按照一定时间间隔Δt 在模拟信号x(t)上采取其瞬时值。即通过采样脉冲和模拟信号相乘来实现。过程如下简图。对于模拟信号采样,首先要确定其采样间隔,即确定Δt的大小,这需要考虑多重因素...

2018-04-18 10:49:42 7724

转载 理解奈奎斯特采样和香农定理

转自: http://blog.ednchina.com/tengjingshu/179701/message.aspx――――――――――――――――――――――――――――――――――――――― 奈奎斯特定理(Nyquist's Theorem)和香农定理(Shannon's Theorem)是网络传输中的两个基本定理。这两天复习无线网络,想想就从基础开始吧,把复习的东西用文字写下来,总结一下...

2018-04-18 09:59:15 8367

原创 压缩感知的一些理解

因为学习分布式视频编码,其中发展趋势有一个方向即是与压缩感知相结合,所以对压缩感知进行了学习,对其稍作了解,将其记录下来,以方便后面学习了解。首先何为压缩感知?用远低于奈奎斯特采样频率的采样频率来采样信号,可以成功重建信号。假设需要重构的信号X N*1,稀疏系数为K,即X N*1 中非零常数为K,远远小于N,采样信号y M*1,由测量系数矩阵ΦM× N获得,M/N<<1为采样率,即采样...

2018-04-17 21:01:55 605

转载 GPIO、UART等区别

GPIO(General Purpose Input Output )为通用输入/输出,通用端口,总线扩展器, 利用工业标准I2C、SMBus™或SPI™接口简化了I/O口的扩展。当微控制器或芯片组没有足够的I/O端口,或当系统需要采用远端串行通信或控制时,GPIO产品能够提供额外的控制和监视功能。UART(Universal Asynchronous Receiver/Transmitter),...

2018-04-12 11:06:34 9892

原创 如何写好一篇文章

想要写好一篇文章,要满足4C原则:Clear:清晰,即写作思路要清晰,对文章概念描述清楚、文章层次结构划分清楚(先列好提纲,然后填充内容)、文章内容表达清楚;Complete:完整,即文章内容要完整,结构要完整,(理论+整体框架+软硬件研究+实验(仿真实验+实际实验)+分析+结论),要做到有始有终;Correct:正确,即文章内容具有科学性,理论正确,数据正确(可靠、可信)、语言正确(语法正确、无...

2018-04-12 11:06:16 394

系统全局时钟控制模块的verilog实现

利用verilog编写系统时钟模块,调用dll的IP核,将输入50MHz的系统时钟信号分频或扩频成所需要的24MHz和100MHz信号,简单易行,亲测可用

2018-07-09

zigzag的verilog实现

利用verilog编码实现输入4*4矩阵块数据的zigzag扫描1*16数据输出,压缩包包括verilog代码以及testbench仿真代码,简单易行,亲测可用。

2018-07-09

FPGA 数字时钟

用verilog 编写的一个数字时钟例程,可以实现24小时计数,还有闹钟报警、校时、校分等功能,程序简单易懂,亲测可行

2018-04-12

QuartusⅡ安装教程(从altera官网下载安装,安装许可证书)

该文档总结从altera官网下载quartusⅡ软件和modelsim软件,以及安装破解过程,纯傻瓜式安装,以图片形式总结过程,简单易懂,并且软件及破解都是从altera官网下载,安全可靠。

2018-02-23

verilog 数字跑表代码

用verilog HDL编写的一个具有“百分秒、秒、分”计时功能的数字跑表,可以实现一个小时以内精确至百分之一秒的计时,注释比较清晰,容易看懂,还可以增加小时的计时功能

2018-01-29

空空如也

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