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嵌入式开发之zynqMp ---Zynq UltraScale+ MPSoC 图像编码板zcu102

嵌入式开发之zynqMp—ZynqUltraScale+MPSoC图像编码板zcu102转载地址:https://www.cnblogs.com/pengkunfan/p/8569986.html1.1xilinxzynqMp架构1.1.116nm级别工艺  ZynqUltraScale+ MPSoC架构 ...

2019-09-04 10:43:32

SPI协议通信

SPI通信协议SPI是同步串行通信接口。SPI是英语SerialPeripheralInterface的缩写,顾名思义就是串行外围设备接口。SPI是一种高速的、全双工、同步通信总线,标准的SPI也仅仅使用4个引脚,常用于单片机和EEPROM、FLASH、实时时钟、数字信号处理器等器件的通信。SPI通信原理比I2C要简单,它主要是主从方式通信,这种模式通常只有一个主机和一个或者多个从机,标...

2018-11-16 22:44:39

VDMA IP的GUI配置介绍【Xilinx-VDMA模块学习】

本文转载自:http://blog.csdn.net/vacajk/article/details/53908661使用的是Vivado2015.4,XC7Z020,AXIVideoDirectMemoryAcess(6.2)。 在我的系统中,GUI配置图片如下:(其实和默认配置没有太大区别) ...

2018-11-15 17:49:12

Matlab中double,im2double,mat2gray函数使用方法介绍

图像类和类型间的转换im2uint8 将输入中所有小于0的设置为0,而将输入中所有大于1的设置为255其他的所有乘以255im2uint16 将输入中所有小于0的设置为0,而将输入中所有大于1的设置为65535mat2gray 把一个double类的任意数组转换成值范围在[0,1]的归一化dou...

2018-11-15 12:00:29

基于FPGA的彩色图转灰度图算法

一、算法基础对于彩色转灰度,有一个很著名的心理学公式:Gray=R0.299+G0.587+B*0.114; 使用移位算法来避免浮点运算,并保证算法的精度; 惯上使用16位精度,2的16次幂是65536,所以这样计算系数:0.299*65536=19595.264≈19595;0.587*65536+(0.264)=38469.632+0.2...

2018-10-23 17:04:16

Verilog 系统函数介绍

1      $display    这个函数系统任务的作用是用来在控制台输出信息。    1)  直接显示字符串$display("!!!StartSimulation!!!");&a

2018-10-16 11:22:05

FPGA基础知识3(xilinx CLB资源详解--slice、分布式RAM和Block ram)

 来源:http://www.eefocus.com/b3574027/blog/15-05/312609_2e5ad.html以下分析基于xilinx7系列CLB是xilinx基本逻辑单元,每个CLB包含两个slices,每个slices由4个(A,B,C,D)6输入LUT和8个寄存器组成。 同一CLB...

2018-09-12 00:44:48

关于锁存器和触发器的一点记录

一,锁存器与寄存器的区别:锁存器与触发器最大的区别在于,锁存器是电平触发,而触发器是边沿触发。锁存器在不锁存数据时,输出随输入变化;但一旦数据锁存时,输入对输出不产生任何影响。首先应该明确锁存器和触发器也是由与非门之类的东西构成。尤其是锁存器,虽说数字电路定义含有锁存器或触发器的电路叫时序电路,但锁存器有很多组合电路的特性。组合电路就是一个真值表,一个函数,一组输入对应一组输出,当前什...

2018-09-05 22:48:18

m序列信号发生器--基于线性移位反馈寄存器LFSR

1.m序列简介m序列是目前广泛应用的一种伪随机序列,其在通信领域有着广泛的应用,如扩频通信,卫星通信的码分多址,数字数据中的加密、加扰、同步、误码率测量等领域。m序列在所有的伪随机序列里面的地位是最基础同样也是最重要的。它的特点就是产生方便快捷,有很强的规律特性,同时自相关性、互相关特性也很好。在IS-95的反向信道中,选择了m序列的PN码作为地址码,利用不同相位m序列几乎正交的特性来为每个...

2018-08-28 17:04:47

静态时序分析博客系列

静态时序分析是FPGA设计中非常重要的一个过程,也是很多FPGA初学者难以理解的地方。写这篇博文的主要目的是,对我最近的所学、所思做一个简要的总结;同时和大家分享一下我的一些想法,博文中可能存在一些不足或者错误的地方,还请各路大神指出。此次连载的博文的主要参考资料为:Lattice、华为、Altera等公司的静态时序参考文档。综合工具为SynplifyP...

2018-08-27 21:25:01

FPGA STA(静态时序分析)---ALTERA FPGA

1FPGA设计过程中所遇到的路径有输入到触发器,触发器到触发器,触发器到输出,例如以下图所看到的:这些路径与输入延时输出延时,建立和保持时序有关。2.应用背景  静态时序分析简称STA,它是一种穷尽的分析方法。它依照同步电路设计的要求。依据电路网表的拓扑结构,计算并检查电路中每个DFF(触发器)的建立和保持时间以及其它基于路径的时延要求是否满足。STA作为FPGA设...

2018-08-27 21:23:14

carry_ahead adder 超前进位加法器

串行进位加法器需要一级一级的进位,进位延迟很大。先行进位加法器(也叫超前进位加法器)可以有效的减少进位延迟。  设二进制加法器的第i位输入为Xi,Yi, 输出为Si, 进位输入为Ci,进位输出为Ci+1...

2018-08-27 09:49:24

关于Verilog HDL的一些技巧、易错、易忘点 daily record

一个小细节always@(posedgeI_clk)beginif(I_rst_p)cnt<=2'd0;elseif(cnt==2'd2)cnt<=2'd0;elsecnt<=cnt+1;endalway...

2018-08-23 11:09:02

以太网理论篇

      以太网理论篇一.计算机网络概述  计算机网络是由若干节点和连接这些节点的链路组成的。网络节点可以是计算机、集线器、交换机或路由器构等。网络之间还可以通过路由器

2018-08-20 18:02:17

XAIU接口协议

ISO七层协议到TCP/IP四层协议的对应关系图:MAC即MediaAccessControl,即媒体访问控制子层协议.该协议位于OSI七层协议中数据链路层的下半部分,主要负责控制与连接物理层的物理介质.在发送数据的时候,MAC协议可以事先判断是否可以发送数据,如果可以发送将给数据加上一些控制信息,最终将数据以及控制信息以规定的格式发送到物理层;在接收数据的时候,MAC协议首先判断...

2018-08-19 23:59:48

基于移位加法的乘法器---Verilog实现

无符号数的乘法,根据乘数的数位计算位积,再将一系列位积相加。便可以得到两个无符号二进制数的乘积。这里可以选择移位的方式。比如out=in*13,in为4位,则out为8位,的计算:assignout=a+a<<2+a<<3;实现。组合逻辑电路乘法器实现:modulemult_module#(parame...

2018-08-14 22:43:13

关于Verilog HDL的一些技巧、易错、易忘点

关键词:  ·技巧篇:      组合逻辑输出类型选择;      语法上的变量交换;   ·易忘篇:      case/casex/casez语句;      循环语句;      数制和操作符;      数据类型;   ·易错:      数据的截位与扩位      子模块例化中隐式线网赋值技巧篇:  1、组合逻辑输出:描述一个纯组合逻辑电...

2018-08-13 11:38:01

基于减法操作除法器的算法---Verilog实现

引言除法器在FPGA里怎么实现呢?当然不是让用“/”和“%”实现。在VerilogHDL语言中虽然有除的运算指令,但是除运算符中的除数必须是2的幂,因此无法实现除数为任意整数的除法,很大程度上限制了它的使用领域。并且多数综合工具对于除运算指令不能综合出令人满意的结果,有些甚至不能给予综合。即使可以...

2018-08-13 10:15:29

FPGA数字信号处理(二)并行FIR滤波器Verilog设计

该篇是FPGA数字信号处理的第二篇,选题为DSP系统中极其常用的FIR滤波器。本文将简单介绍FIR滤波器的原理,详细介绍使用VerilogHDL设计并行FIR滤波器的流程和方法。接下来几篇会介绍串行结构FIR的Verilog设计、使用Quartus和Vivado的IP核设计FIR的方法。数字滤波器数字滤波器...

2018-08-12 16:53:31

串行FIR滤波器---Verilog设计

数字滤波器数字滤波器从实现结构上划分,有FIR和IIR两种。FIR的特点是:线性相位、消耗资源多;IIR的特点是:非线性相位、消耗资源少。由于FIR系统的线性相位特点,设计中绝大多数情况都采用FIR滤波器。线性相位系统的意义,这里的线性相位指的是在设计者关心的通带范围内,LTI系统满足线性相位要求:1.从延时的角度看:保证了输入信号的相位响应是线性的,即保证了输入信号的延时特性。...

2018-08-11 23:37:52

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